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SV(2)
发布于: 2023-4-20
最后更新: 2023-11-30
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IC验证
目录
0%
2.1、系统总线简介
2.2、AMBA 2.0
2.3、AMBA 发展历史
2.4、一个典型的 AMBA 2.0 系统
2.5、AMBA2.0 AHB
2.6、AMBA2.0 APB
2.7、AHB 组成部分
2.8、APB 组成部分
2.9、AMBA 协议其他有关问题
2.10、例：DMA
2.1、一个典型的 AMBA 2.0 系统
2.2、AHB 总线互连
2.3、AHB 传输
2.4、Dummy/Default Master
2.4.1、Dummy Master（用的不多）
2.5、Default Slave
2.6、AHB 信号
2.7、基本 AHB 信号
2.8、基本 AHB 传输
2.8.1、一次无需等待状态的简单传输
2.8.2、需要两个等待周期的简单传输
2.8.3、流水线（Pipeline）
2.8.3、Burst Transfer（基本没用，作为了解即可！）
2.9、传输类型
2.10、传输类型举例
2.11、其他 AHB 控制信号
2.12、AHB 控制信号小结
2.13、Review
文章目录
一、BURST 传输（了解）
1.1、地址计算举例
1.2、INCR Burst
1.3、WRAP8 Burst
1.4、INCR4 Burst
1.5、WRAP4 Burst
1.6、未定义长度的 Burst 传输
1.7、Example LDM AHB Activity
1.8、注意
1.9、INCR Burst over 1k boundary
二、地址译码
2.1、从设备响应
2.2、两周期的响应
2.3、Slave Response
2.4、Retry 响应
2.5、Rerty 和 SPLIT 的不同
三、数据总线
3.1、32 bit 小端数据总线的有效字节
3.2、32 bit 大端数据总线的有效字节
四、主设备
4.1、AHB 仲裁信号（了解）
4.2、仲裁信号解释（了解）
4.3、仲裁举例
4.4、总线主设备 Grant 信号
4.5、几点说明（了解即可）
4.6、SPLIT 传输过程
4.7、防止 DeadLock（死锁）
五、AHB 设备接口
5.1、AHB 主设备接口（要会画）
5.2、AHB 从设备接口（要会画）
5.3、AHB Arbiter（要会画）
5.4、AHB Decoder（要会画）
六、Typical Multi-layer example（了解）
七、AHB-Lite（业界目前用的比较多的）
八、AHB 总结
九、AHB 的应用建议
十、实现
1.1、AMBA 发展史
1.2、典型的 AMBA 系统
2.1、AHB 总线组成
2.2、AHB 总线互连示意图
2.3、AHB 操作概述
2.4、AHB 基本传输阶段
3.1、AHB 信号描述（重要）
3.2、基本 AHB 传输（重要）
3.2.1、零等待传输 (no wait state transfer)
3.2.2、等待传输 (transfers with wait states)
3.2.3、多重传送 (multiple transfer) - 流水操作 Pipeline
3.3、AHB 控制信号
3.3.1、传送状态 HTRANS[1:0]
3.3.2、批量传送 HBURST[2:0]
3.3.3、传送方向 HWRITE
3.3.4、传送大小 HSIZE[2:0]
3.3.5、保护控制 HPROT[3:0]
3.4、AHB 响应信号
3.4.1、slave 可以如下方式完成一笔传输
3.4.2、传输完成标志 HREADY
3.4.3、传输响应标志 HRESP[1:0]
3.4.4、地址译码
3.4.5、仲裁
4.1、AHB 主设备接口（要会画）
4.2、AHB 从设备接口（要会画）
4.3、AHB Arbiter（要会画）
4.4、AHB Decoder（要会画）
2.1、APB 与 AHB 对比
2.2、APB 信号介绍
2.3、APB 信号释义
2.4、APB Slave 地址译码
2.5、APB 互联示意图
2.6、APB 时序（重要）
2.6.1、写传输
2.6.2、读传输
2.7、APB Bridge
2.8、APB Bridge FSM（状态机）
2.9、APB Slave 框图（接口信号，需要会画）
2.10、APB 到 AHB 的时序转换 - 读
3.1、通信方式
3.2、Memory Mapped IO
3.3、IP 间的通信互联
3.4、 一个 IP 可以可以同时拥有主设备接口和从设备接口
3.5、CPU 与 IP 之间的通信
4.1、AHB
4.2、APB
8.1、输入端口有 X（出现红色）
8.2、输入端口有 Z（出现蓝色）
8.3、hrdata 为什么是红色的 x？
8.4、调试经验（实践中体会）
8.5、在波形图中双击左键的效果
8.6、将 source code 中的信号添加到波形中
8.7、查找信号的驱动
4.1、接口 interface
4.2、数据包 transaction
4.3、数据包生成器 generator
4.10、采样模块 monitor
4.11、比对模块 scoreboard
4.12、其他组件修改
4.12.1、environment.sv 修改
4.12.2、Makefile 修改
2.1、错误 1 示例（语法错误）
2.2、错误 2 示例（语法错误）
2.3、错误 3 示例（逻辑错误）
一、AHB-SRAMC 项目介绍
1.1、AHB 总线控制单元（ahb_slave_if.v）
1.2、SRAM 控制单元（sram_top.v）
1.3、主要的传输路径
二、结构框图
2.1、AHB_SRAMC 结构图（重点）
2.2、总线控制单元与 SRAM 控制单元结构图
三、部分核心代码 (重点理解)
四、SystemVerilog Testbench 架构（重点）
五、AHB-SRAMC 目录结构回味
六、一些想说的话
Conor
光机设计与可靠性工程实践者
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2.2、AMBA 2.0
2.3、AMBA 发展历史
2.4、一个典型的 AMBA 2.0 系统
2.5、AMBA2.0 AHB
2.6、AMBA2.0 APB
2.7、AHB 组成部分
2.8、APB 组成部分
2.9、AMBA 协议其他有关问题
2.10、例：DMA
2.1、一个典型的 AMBA 2.0 系统
2.2、AHB 总线互连
2.3、AHB 传输
2.4、Dummy/Default Master
2.4.1、Dummy Master（用的不多）
2.5、Default Slave
2.6、AHB 信号
2.7、基本 AHB 信号
2.8、基本 AHB 传输
2.8.1、一次无需等待状态的简单传输
2.8.2、需要两个等待周期的简单传输
2.8.3、流水线（Pipeline）
2.8.3、Burst Transfer（基本没用，作为了解即可！）
2.9、传输类型
2.10、传输类型举例
2.11、其他 AHB 控制信号
2.12、AHB 控制信号小结
2.13、Review
文章目录
一、BURST 传输（了解）
1.1、地址计算举例
1.2、INCR Burst
1.3、WRAP8 Burst
1.4、INCR4 Burst
1.5、WRAP4 Burst
1.6、未定义长度的 Burst 传输
1.7、Example LDM AHB Activity
1.8、注意
1.9、INCR Burst over 1k boundary
二、地址译码
2.1、从设备响应
2.2、两周期的响应
2.3、Slave Response
2.4、Retry 响应
2.5、Rerty 和 SPLIT 的不同
三、数据总线
3.1、32 bit 小端数据总线的有效字节
3.2、32 bit 大端数据总线的有效字节
四、主设备
4.1、AHB 仲裁信号（了解）
4.2、仲裁信号解释（了解）
4.3、仲裁举例
4.4、总线主设备 Grant 信号
4.5、几点说明（了解即可）
4.6、SPLIT 传输过程
4.7、防止 DeadLock（死锁）
五、AHB 设备接口
5.1、AHB 主设备接口（要会画）
5.2、AHB 从设备接口（要会画）
5.3、AHB Arbiter（要会画）
5.4、AHB Decoder（要会画）
六、Typical Multi-layer example（了解）
七、AHB-Lite（业界目前用的比较多的）
八、AHB 总结
九、AHB 的应用建议
十、实现
1.1、AMBA 发展史
1.2、典型的 AMBA 系统
2.1、AHB 总线组成
2.2、AHB 总线互连示意图
2.3、AHB 操作概述
2.4、AHB 基本传输阶段
3.1、AHB 信号描述（重要）
3.2、基本 AHB 传输（重要）
3.2.1、零等待传输 (no wait state transfer)
3.2.2、等待传输 (transfers with wait states)
3.2.3、多重传送 (multiple transfer) - 流水操作 Pipeline
3.3、AHB 控制信号
3.3.1、传送状态 HTRANS[1:0]
3.3.2、批量传送 HBURST[2:0]
3.3.3、传送方向 HWRITE
3.3.4、传送大小 HSIZE[2:0]
3.3.5、保护控制 HPROT[3:0]
3.4、AHB 响应信号
3.4.1、slave 可以如下方式完成一笔传输
3.4.2、传输完成标志 HREADY
3.4.3、传输响应标志 HRESP[1:0]
3.4.4、地址译码
3.4.5、仲裁
4.1、AHB 主设备接口（要会画）
4.2、AHB 从设备接口（要会画）
4.3、AHB Arbiter（要会画）
4.4、AHB Decoder（要会画）
2.1、APB 与 AHB 对比
2.2、APB 信号介绍
2.3、APB 信号释义
2.4、APB Slave 地址译码
2.5、APB 互联示意图
2.6、APB 时序（重要）
2.6.1、写传输
2.6.2、读传输
2.7、APB Bridge
2.8、APB Bridge FSM（状态机）
2.9、APB Slave 框图（接口信号，需要会画）
2.10、APB 到 AHB 的时序转换 - 读
3.1、通信方式
3.2、Memory Mapped IO
3.3、IP 间的通信互联
3.4、 一个 IP 可以可以同时拥有主设备接口和从设备接口
3.5、CPU 与 IP 之间的通信
4.1、AHB
4.2、APB
8.1、输入端口有 X（出现红色）
8.2、输入端口有 Z（出现蓝色）
8.3、hrdata 为什么是红色的 x？
8.4、调试经验（实践中体会）
8.5、在波形图中双击左键的效果
8.6、将 source code 中的信号添加到波形中
8.7、查找信号的驱动
4.1、接口 interface
4.2、数据包 transaction
4.3、数据包生成器 generator
4.10、采样模块 monitor
4.11、比对模块 scoreboard
4.12、其他组件修改
4.12.1、environment.sv 修改
4.12.2、Makefile 修改
2.1、错误 1 示例（语法错误）
2.2、错误 2 示例（语法错误）
2.3、错误 3 示例（逻辑错误）
一、AHB-SRAMC 项目介绍
1.1、AHB 总线控制单元（ahb_slave_if.v）
1.2、SRAM 控制单元（sram_top.v）
1.3、主要的传输路径
二、结构框图
2.1、AHB_SRAMC 结构图（重点）
2.2、总线控制单元与 SRAM 控制单元结构图
三、部分核心代码 (重点理解)
四、SystemVerilog Testbench 架构（重点）
五、AHB-SRAMC 目录结构回味
六、一些想说的话
